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无线通信

 

Xilinx 提供了针对 RF 数字前端（DFE）信号处理、基带处理（包括前向纠错（FEC）、傅立叶变换和自适应调制）和先进接口等领域中无线网络设备的高性能、经济型解决方案，以及连接功能和桥接解决方案。Xilinx 和我们的合作伙伴提供：

  • 参考设计和硬件平台，来简化高性能无线电和基带处理功能的开发。
  • 灵活的、可升级解决方案，解决了不断变化的标准的挑战，如 WCDMA、WiMAX、TD-SCDMA 和 LTE。
  • IP 和参考设计，支持最新的无线电、基带和 DSP 连接功能标准，如 CPRI、OBSAI 和 SRIO。
  • 业内领先的 FEC 解决方案，如高级 Turbo 编解码器算法，提高了吞吐量，降低了延迟，并削减了单位通道的成本。
  • 全面的网络解决方案，支持新的、低延迟、基站架构和向全 IP 核与回程网络过渡的开发。

按功能和类型分，现有资源包括：

利用最新的 Virtex™-5 FPGA 的性能来实现您最具挑战性的无线解决方案。

无线通信资源还用于：

接口和连接功能
主题 资源 类型 供应商
OBSAI RP3 OBSAI RP3/RP3-01 v4.0 IP 核
器件架构：Virtex-5 LXT/SXT		 IP Xilinx 公司
OBSAI RP3 参考设计（需要登录）
器件架构：Virtex-II Pro/Virtex-4		 参考设计 Xilinx 公司
CPRI CPRI v2.1 IP 核
器件架构：Virtex-5 LXT/SXT
 IP Xilinx 公司
CPRI 参考设计（需要登录）
器件架构：Virtex-II Pro/Virtex-4		 参考设计 Xilinx 公司
SRIO SRIO 客户搜索 Xilinx 公司
PCI Express® PCI Express 的开发套件 开发套件 Xilinx 公司
以太网 MAC Virtex-5 LXT/SXT FPGA 的以太网 MAC 内置式硬 IP 芯片特性 Xilinx 公司
EMIF XAPP753 - 利用 EMIF 将 FPGA 连接到 TMSC6000 DSP 平台上（PDF） 应用指南 Xilinx 公司
VLYNQ DS324 - VLYNQ v1.2（PDF） 数据手册 Xilinx 公司
面向 Texas Instruments 处理器的 VLYNQ 接口 IP Xilinx 公司
LinkPort XAPP634 - Analog Devices TigerSHARC 链路（PDF） 应用指南 Xilinx 公司
XAPP635 - 通过 LVDS 链路端口连接 Virtex-II 系列 FPGA 和 Analog Devices TigerSHARC TS20x DSP（PDF） 应用指南 Xilinx 公司
高速 ADC/DAC 接口 ADC/DAC 应用指南 客户搜索 Xilinx 公司
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RF（射频卡）
主题 资源 类型 供应商
数字预失真（DPD） 数字预失真参考设计
已经开发出了先进的高性能数字预失真解决方案，并且现已开始向选定用户提供。
器件架构：Virtex-4 SX、Virtex-5 SXT
多种 PA 类型：Doherty、AB 类、LDMOS、GaN
多种标准：LTE、WCDMA、WiMAX、TD-SCDMA、GSM
频谱校正范围：15db – 33dB		 参考设计 Xilinx 公司
波峰消减 - 振幅因数缩小（PC-CFR） PC-CFR 参考设计（需要登录）
器件架构：Virtex-4、Virtex-5 FPGA
支持多种采样速率和空中接口标准
极低的功耗
占位面积小的优化设计
提供 System Generator 实例：TD-SCDMA		 参考设计 Xilinx 公司
WCDMA/HSPA WCDMA/HSPA 参考设计（需要登录）
器件架构：Virtex-4、Virtex-5 FPGA
DUC：3个载波
DDC：6个载波（接收器分集）
CFR：3个载波（PAPR<6 dB@<11% EVM，>60 dB ACLR）		 参考设计 Xilinx 公司
WiMAX WiMAX 参考设计（需要登录）
器件架构：Virtex-4、Virtex-5 FPGA
DUC：1个载波（动态开关频率为3.5、5、7和10 MHz）
DDC：1个载波（动态开关频率为3.5、5、7和10 MHz）
CFR：1个载波（PAPR>1.5 dB@2% EVM）		 参考设计 Xilinx 公司
WiMAX 参考设计（需要登录）
器件架构：Spartan-3A DSP FPGA
DUC：1个载波（动态开关频率为5和10 MHz）
DDC：1个载波（动态开关频率为5和10 MHz）		 参考设计 Xilinx 公司
TD-SCDMA TD-SCDMA 参考设计（需要登录）
器件架构：Virtex-4 FPGA
DUC：载波多达6个
DDC：载波多达6个		 参考设计 Xilinx 公司
DUC/DDC 调制和解调 IP
器件架构：各种		 客户搜索 Xilinx 公司和合作伙伴
XAPP1018 - 利用 System Generator 和 Core Generator 设计高效的 DUC/DDC（PDF） 应用指南 Xilinx 公司
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基带处理（通道卡）
主题 资源 类型 供应商
LTE 通道编码器/解码器 LTE 通道编码器/解码器 LogiCORE IP 支持资料
 白皮书
应用指南		 Xilinx 公司 
WCDMA/HSPA RACH LogiCORE IP Xilinx 公司
搜索器 LogiCORE IP Xilinx 公司
WiMAX FEC WiMAX IEEE802.16-2004 FEC 参考设计（需要登录）
System Generator 8.1 或更高版本
Tx 和 Rx 链，包括随机函数发生器/解随机函数发生器（Randomiser/Derandomizer）、RS/Viterbi FEC 编码/解码、交织器/解交织器、QAM 映射器/解映射器		 参考设计 Xilinx 公司
FEC 核 Turbo 编解码器 IP 客户搜索 Xilinx 公司
Reed-Solomon IP 客户搜索 Xilinx 公司
Viterbi/卷积 IP 客户搜索 Xilinx 公司
LDPC IP 客户搜索 Xilinx 公司
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